研究院-数字逻辑验证工程师-成都

【职位描述】 1、主导子系统的验证工作，根据SPEC制定验证策略方案、验证计划和分解测试用例； 2、搭建基于UVM的仿真平台； 3、仿真用例执行，收集并分析覆盖率报告； 4、执行网表后仿真测试，协助FPGA原型测试； 5、与设计紧密配合，协助设计解决逻辑问题； 6、验证进度、质量、风险管理，确保验证按时交付； 7、主导开展验证质量活动，负责编写验证报告并通过评审。 【任职要求】 1、熟悉UVM验证方法学； 2、熟悉System Verilog语言，熟悉Tcl,shell,Perl,python等脚本语言； 3、熟悉项目开发流程，能够依据流程开展验证活动； 4、熟悉常见接口协议，如AMBA,SPI,URAT,IIC等； 5、熟练使用VCS,Verdi等EDA工具； 6、良好的问题分析解决能力、沟通能力和团队协作能力； 7、3年以上验证工作经验，有项目/团队管理经验优先。

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